PCB品质验证的时域串扰测量法的技术分析

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　　图10：测量得到的反向串扰。
　　因为此时干扰脉冲的上升时间要大于走线的线长，故脉冲边沿沿走线方向回传到走线源端时还未到达幅度顶点。图11所示为利用一台200 ps上升时间发生器(DG2040)和80E04采样模块的17 ps发生器的输出作为干扰脉冲时得到的串扰测量结果。图中显示的3个串扰波形均采用5 mV/div的电压刻度。

    
　　图11：反向串扰与信号上升时间是相互独立的。
　　其中，白色波形是上升时间为17 ps的干扰脉冲产生的串扰经波形运算功能后滤波(post filtering)到200ps上升时间的结果。这些测量都证实，除非干扰脉冲的上升时间超过走线长度，否则该上升时间并不能影响反向串扰。而如果干扰脉冲的上升时间超过走线长度，那么产生的反向串扰幅度较小，因为在此情况下脉冲边沿走过整条走线都还不能达到幅度顶点。
　　电路设计对串扰的影响
　　虽然通过仔细的PCB设计可以减少串扰并削弱或消除其影响，但电路板上仍可能有一些串扰残留。因此，在进行电路设计时，还应采用合适的线端负载，因为线端负载会影响串扰的大小和串扰随时间的弱化程度。下面是一个测量实例，它揭示了走线末端与逻辑门电路输出处的线端负载会怎样衰减串扰并减弱形成串扰的成因。