高速PCB设计中一体化的设计流程简介
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布线编辑器(FIRE)具有多种设计规则检查(DRC)模式和新的布线编辑功能。设计工程师可以自动添加“Z”型插孔，寻找差分对，监控走线长度或根据特定的约束规则进行设计。这样，设计工程师可以更容易实现密集布线设计，在最少的板层上实现更大的布线密度。
此外，该工具还提供了一个图解反馈功能，为设计工程师指出某布线选择对板上其它网络的影响。过去，设计工程师很难知道关键网络的修改对设计的其它部分有什么影响。BlazeRouter HSD将这些过去难以了解的影响用图解的形式表示出来，用不同的颜色和亮度表示不同的影响。这能够帮助设计工程师了解每一个布线选择可能存在的影响。 建立一套完整的设计方法 在解决如今电路板设计中普遍存在的高速问题方面，以上这些工具代表了当前最主要的发展。但是，设计工具还必须增加更多的功能来适应电路板设计中快速增长的时钟速度和复杂性，特别是需要用一个综合的设计方法来替代现在的多点设计工具。 新方法具有怎样的设计流程呢?为了解决关键路径中的高速问题，必须在流程最初的设计定义阶段添加新的功能。要达到这一目的，新方法必须有强大的仿真和分析能力。同时，必须能了解电路板设计的关键数据，尤其是有关元器件的可用性和成本等信息。理想的情况是，设计工程师通过设计平台能实现整个公司内部的协作，设计工程师通过网络不但可以在设计工程师之间交流设计思想，还可以与采购和生产等其它部门进行沟通。 同时，高速电路板的设计在很大程度上依赖于一种约束生成方法。当前，设计工程师将电子设计数据和设计约束条件输入到电路板绘图软件实现电路设计，但信号完整性问题和电路板设计日益增加的复杂度使问题更加复杂化。为解决这些高速和复杂电路板上的信号完整性问题，他们必须在绘制电路板之前就对设计进行仿真和综合。这就对设计环境提出了新要求，从电特性到制造工艺，设计工程师都必须制定约束条件。在一个理想的设计平台上，设计工程师不但可以针对走线长度、电磁干扰或串扰等参数制定电特性规则，而且可以针对元件间隔、高度限制和旋转角度设置元件放置规则。 为了快速生成这类约束条件，该设计环境必须具有强大的拓扑分析和“可能情况”分析能力。最好能允许设计工程师以电路图形式设计和仿真网络拓扑，允许采用信号完整性分析引擎在多次仿真中改变拓扑参数，然后还可以研究各种端接方案，并使之与延迟约束条件、电路层选项和走线间距共同作用，使信号完整性受到的影响降至最低。这种功能还应该与元件的放置紧密结合，并与规划功能联系起来，这样，设计工程师才好定义初始的元件放置，并了解布线策略的性能。总而言之，新的设计环境必须提供强大的约束条件管理能力，以便设计工程师组织和管理众多的信息。 不仅如此，这种新的面向高速设计的方法在开发过程的后期还必须提供校验功能。过去，电路设计工程师只有当板上存在关键网络才进行布线后期校验，而对整个电路板设计进行完全的综合校验则认为复杂费时。但这一观点正在变化，因为今天的高速电路板设计中，成千上万的网络之间复杂的交互作用很难预测。要保证设计的可靠性，唯一的办法就是对整个布线设计进行彻底的整体仿真。 一个理想的高速设计流程能够解决这些问题，该流程所使用的设计环境必须包含高速、高精度的信号分析引擎，能够在一段相对较短的时间内完成板上所有信号的仿真。同时，该仿真引擎还必须能仿真多个电路板和多个设备等可能情况，并支持该引擎所在设计环境可能会使用的多个PCB数据库。 |
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